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Programming Model Quick Reference
Table 6-19. HI08 Programming Model, DSP Side (Continued)
Bit
Reset Type
Register
Bit
No.
Bit
Name
Value
Function
HW/
SW
Indivi-
dual
STOP
HBAR
7–0
BA[10–3
Host Base
$80
]
Address
Register
HRX
HTX
23–
0
23–
0
DSP Receive
Data Register
DSP Transmit
Data Register
empt
y
empt
y
HDR
16–
D[16–0]
GPIO signal
$000
—
—
0
Data
0
HDRR
16–
DR[16–
GPIO signal
0
Input
$000
—
—
0
0]
Direction
1
Output
0
Table 6-20. HI08 Programming Model: Host Side
Bit
Reset Type
Reg
#
Name
Value
Function
HW/
SW
Indi
vi-d
ual
STOP
ICR
0
RREQ
Receive Request Enable
0
HRRQ interrupt disabled
0
—
—
1
HRRQ interrupt enabled
1
TREQ
Transmit Request Enable
0
HTRQ interrupt disabled
0
—
—
1
HTRQ interrupt enabled
2
HDRQ
Double Host Request
0
HREQ/HTRQ = HREQ,
0
—
—
HACK/HRRQ = HACK
1
HREQ/HTRQ = HTRQ,
HACK/HRRQ = HRRQ
3
4
HF0
HF1
Host Flag 0
Host Flag 1
0
0
—
—
—
—
5
HLEND
Host Little Endian
0
Big Endian order
0
—
—
1
Little Endian order
7
INIT
Initialize
1
Reset data paths according to
0
—
—
TREQ and RREQ
DSP56311 User’s Manual, Rev. 2
Freescale Semiconductor
6-31
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